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demi-additionneur

Domaine
  1. informatique
Auteur
Office québécois de la langue française
Dernière mise à jour
1999
  • Accéder à la fiche en anglais : half adder

Définition :

Circuit logique, utilisé pour des opérations d'addition, qui possède deux bits en entrée et deux bits en sortie, dont un bit de somme (sans retenue) et un bit de report (représentant la retenue) en sortie.

Termes privilégiés :

demi-additionneur n. m.
additionneur à deux entrées n. m.

Traductions

  • anglais

    Auteur : Office québécois de la langue française, 1999

    Terme :

    1. half adder

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